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xiwenxian  发布于  2019-01-22 17:19:16
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遇到了一点问题想请教各位大神

Xilinx
 
FPGA
 
新唐
 
屏显
 
各位兄弟，我最近在做一个基于zedboard从PS内存到PL高速传输高速通道AXI-HP到AXI-Stream的转换的东西   遇到了一点问题想请教大家一下。
就是 AXI HP接口读数据的时候是根据PL端提供的地址DDR向PL端提供数据，如果转换成AXI-stream接口是不是通过地址的自加来把数据形成stream的形式？还是有其他别的思路？
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