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Xilinx(赛灵思)是全球领先的可编程逻辑完整解决方案的供应商。Xilinx研发、制造并销售范围广泛的高级集成电路、软件设计工具以及作为预定义系统级功能的IP（Intellectual Property）核。

720P以上视频输出图像效果优化
sss 全志 Xilinx

liuweifeng 发布于2017年01月09日

0 1k
怎么把文件里的图片数据导入vivado作为仿真时候的输入呢？
Xilinx FPGA 瑞芯微 MTK

aaronliu 发布于2018年12月30日
aaronliu 回复于2018-12-30 13:33:49

1 368
请教各位大神，SDK交叉编译器怎么安装
sss Xilinx 屏显

damonzhong 发布于2018年07月13日
hero 回复于2018-07-16 17:41:34

3 986
关于拷贝默认文件这个是什么问题，谢谢！
全志 Xilinx 三星

k0000000k 发布于2019年01月17日
jgbl 回复于2019-01-17 13:37:21

1 404
这个问题是什么原因？是不是要修改什么地方？
Xilinx FPGA 屏显树莓派

soft_heart 发布于2019年01月29日

0 469
支持Xilinx FPGA中的32位 DDR4 SDRAM
Xilinx FPGA sss 三星

sramsun 发布于2020年05月18日

0 347
Hi3531A 视频输出接口问题
sss MTK Xilinx

qn1522720710 发布于2019年12月10日
qn1522720710 回复于2019-12-10 14:54:52

1 396
各位，谁遇到过，之前在sdk下烧录程序都是ok，过几天显示发现，即使拿xilinx例子无...
Xilinx FPGA 新唐屏显

xiangrilia 发布于2018年12月12日

0 320
hi3520D-SDK4.0 UBOOT自制开机LOGO
sss MTK Xilinx

doufunao 发布于2016年03月23日
hero 回复于2017-08-22 13:43:24

26 7k
社区有人用过qsf28不？和qsfp是不是兼容的
Xilinx FPGA 新唐瑞芯微

ww0705 发布于2018年12月21日

0 420
請問開怎麼透過PTZ去控制聚焦和焦距
sss Xilinx 屏显

a9102936 发布于2017年10月26日
prqu 回复于2018-08-15 20:53:45

1 1k
请问谁懂视频解码帮忙看一下
全志 MTK Xilinx

tvmnu 发布于2019年01月07日

0 449
[跟学第一期]Linux应用程序开发指南-QT及交叉环境配置
新唐君正 Xilinx

途行者阿杜发布于2017年12月03日
colorjun 回复于2017-12-04 00:07:10

5 2.2k
有人调试过Xilinx的Aurora吗？channel up信号时钟不拉高怎么办？
Xilinx FPGA MTK 屏显

flyman46 发布于2019年01月08日

0 1.1k
在AMP模式下，cpu1的中断无法响应。怎么办？
Xilinx FPGA 高通三星

podaxwenh 发布于2019年01月11日
podaxwenh 回复于2019-01-11 15:50:38

10 691
想请问一下在zynq 视频传输过程中，VDMA的视频数据频率和配置频率分别是怎么设置的...
Xilinx FPGA 新唐树莓派

feixue 发布于2018年11月30日
feixue 回复于2018-11-30 17:31:10

3 632
请问一下那个fclk应该是有时钟输出的，为啥提示没有时钟输入
Xilinx FPGA 瑞芯微树莓派

k0000000k 发布于2019年01月23日
mylatex 回复于2019-01-23 13:41:37

1 578
hi3516V300 硬件原理图和PCB
sss 君正 MTK Xilinx 三星

rafael_wl 发布于2019年08月08日
qn1535522399 回复于2019-08-08 15:38:19

3 652
dialog用 ButterKnife 需要解绑吗?
全志 Xilinx 三星

jgbl 发布于2018年12月08日

0 445
3518A源码，真正的干货！
新唐 Xilinx 屏显

no_water 发布于2015年05月26日
fang_hw 回复于2017-07-05 10:40:22

27 7.7k
请问各位大神全志melis系统打印输出当前内存大小是如何操作哦？
全志 Xilinx 三星

tvmnu 发布于2018年12月18日

0 411
3520D，基于QT的linux开发，滚动字幕
sss 君正 Xilinx

kangyongsong 发布于2017年02月27日
qn1528784679 回复于2019-02-19 16:12:34

6 1.6k
调PCI中断，用中断方式需要多快的中断才能保证不丢数？
Xilinx FPGA OpenCV sss

清风听雨发布于2019年01月03日

0 347
各位大神，全志h3或者h5，下发到串口的数据是5组，但是全志板子上读出来的却只有4...
全志 Xilinx 三星

nfcf 发布于2018年08月10日
pibn 回复于2018-08-20 17:49:22

6 802
请问大家用什么 FMC 的扩展板？
Xilinx FPGA 全志瑞芯微

机遇发布于2019年01月18日

0 383
请问出现这种警告是什么原因？
Xilinx FPGA 高通三星

tigercat 发布于2019年01月29日

0 434
适用于Xilinx Virtex-7 FPGA开发板的32位DDR4 SDRAM
Xilinx FPGA 瑞芯微三星

sramsun 发布于2020年06月05日
sramsun 回复于2020-06-05 15:02:43

1 333
海思hi3751 Android 存储开发指南
sss 君正 MTK Xilinx 三星

kenneth197 发布于2020年01月14日

0 422
C语言入门笔记
sss 君正 MTK 高通 Xilinx

LEXE 发布于2018年12月13日

0 336
不错，可惜币不够。。。。。
sss Xilinx 三星

tdx_dahua 发布于2016年04月28日

0 1.2k
谁之前用过四核Cortex-A9A8安卓ARM9迅为linux2440嵌入式4412开发板andro 开发板
全志 MTK Xilinx

aking 发布于2018年12月24日
qn1544161857 回复于2018-12-24 11:22:52

1 400
请问vivado HLS生成的IPcore能否移植到altera的芯片上？
Xilinx FPGA 全志瑞芯微

yesji 发布于2018年12月24日
yesji 回复于2018-12-24 15:29:08

2 385
请教：Hi3521A,UART0异常，输出锯形波，导致不能写UBOOT
sss OpenCV Xilinx

Shawyoo 发布于2018年02月07日
qn1514448727 回复于2018-03-15 16:58:59

1 1.1k
请问怎么用ps 访问pl的印脚？
Xilinx FPGA 高通 MTK

qyp1647 发布于2019年01月13日
Jako 回复于2019-01-13 10:49:39

2 383
我用Z7 的板子，做了PL与PS之间的通信，SDK上面做到了信息互通，怎么生成BOOT.bin ...
Xilinx FPGA 君正高通

zgdhappy 发布于2018年12月02日

0 443
请问一下大佬们，下面这个是怎么弄出来的
Xilinx FPGA 君正 MTK

tvmnu 发布于2019年01月23日

0 429
Hi3518E的 SDK
sss 君正 MTK OpenCV Xilinx

pnhsd035 发布于2019年08月22日
iokuraki 回复于2020-06-12 00:48:34

20 1.8k
请问下，DDR3 突发单位是bit还是byte？应该是数据总线的整数倍吧？
Xilinx FPGA 瑞芯微 MTK

chivalry 发布于2018年12月10日

0 274
3520D板U-BOOT烧写文件系统奇葩问题求解（已解决）
sss 瑞芯微 Xilinx

jp1017 发布于2015年06月18日
hero 回复于2017-06-30 15:59:44

17 7.4k
各位，ddr仿真 DQ输出为x，这是什么原因啊？时序什么的看着也都对啊
Xilinx FPGA sss 三星

走天涯hd 发布于2018年12月18日

0 596

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