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Xilinx

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Xilinx(赛灵思)是全球领先的可编程逻辑完整解决方案的供应商。Xilinx研发、制造并销售范围广泛的高级集成电路、软件设计工具以及作为预定义系统级功能的IP（Intellectual Property）核。

自定义的IP核，生成的目录怎么多出一个f_ 有知道的大佬帮忙解释一下么？
Xilinx FPGA OpenCV 全志

general 发布于2018年12月14日
general 回复于2018-12-14 16:22:04

2 407
关于拷贝默认文件这个是什么问题，谢谢！
全志 Xilinx 三星

k0000000k 发布于2019年01月17日
jgbl 回复于2019-01-17 13:37:21

1 403
有没有用vivado 17.4跑过zed 的HDMI参考工程？
Xilinx FPGA 新唐瑞芯微

banxianyue 发布于2018年12月29日
banxianyue 回复于2018-12-29 16:16:46

2 405
这个问题是什么原因？是不是要修改什么地方？
Xilinx FPGA 屏显树莓派

soft_heart 发布于2019年01月29日

0 469
在hi3520d板子上，运行./sample_hifb没有图片显示
sss 高通 Xilinx

快乐之人发布于2015年08月05日
快乐之人回复于2015-08-13 10:09:32

7 2.3k
Hi3531A 视频输出接口问题
sss MTK Xilinx

qn1522720710 发布于2019年12月10日
qn1522720710 回复于2019-12-10 14:54:52

1 396
为什么TB上买的开发板运行sample没有问题，自己做的板子确没有视频输出
sss 瑞芯微 Xilinx

randyhsd 发布于2017年06月09日
hero 回复于2017-06-30 14:22:00

7 1.5k
请问这个有谁遇到过？usb插上之后打印这样的错误
sss 新唐 Xilinx

hai 发布于2018年09月27日
qn1533613062 回复于2018-09-29 16:07:00

5 887
有人在搞fdkaac吗？ mips上编译不过，指导一下
君正 MTK Xilinx

pchter 发布于2018年11月03日
pchter 回复于2018-11-03 10:31:39

5 739
请问在哪能看到这个时钟给配置多大啊？
Xilinx FPGA sss 屏显

黄老麦发布于2018年12月12日
0WFA3 回复于2018-12-12 15:35:14

1 378
在AMP模式下，cpu1的中断无法响应。怎么办？
Xilinx FPGA 高通三星

podaxwenh 发布于2019年01月11日
podaxwenh 回复于2019-01-11 15:50:38

10 691
01-Android 解决方案开发指南
sss 君正 MTK Xilinx 三星

a306860657 发布于2018年12月21日

0 491
请问一下那个fclk应该是有时钟输出的，为啥提示没有时钟输入
Xilinx FPGA 瑞芯微树莓派

k0000000k 发布于2019年01月23日
mylatex 回复于2019-01-23 13:41:37

1 577
请问是否一个时钟的脉冲很容易采不到？
Xilinx FPGA MTK 三星

srici_yb 发布于2019年01月07日

0 336
hi3516V300 硬件原理图和PCB
sss 君正 MTK Xilinx 三星

rafael_wl 发布于2019年08月08日
qn1535522399 回复于2019-08-08 15:38:19

3 652
A20 图片叠加文字
全志 Xilinx sss

surgelsm 发布于2016年10月29日
钓鱼大师回复于2017-06-05 11:06:13

1 1.6k
报名hi3519V101的朋友请加企鹅号
sss 高通 Xilinx

途行者阿杜发布于2018年05月07日

0 822
请问各位大佬，有人碰到吗？printk 自动换行
Xilinx FPGA OpenCV MTK

阿衰发布于2018年12月07日

0 591
请问下 vivado默认装在c盘吗？
Xilinx FPGA 瑞芯微 MTK

pat1110 发布于2018年12月04日
5E4X7 回复于2018-12-04 17:52:51

1 417
我自己写了一个PL端的verilog，想连接AXI_HP来对DDR内存读写，请问我写的verilog到...
Xilinx FPGA 新唐全志

明熙发布于2018年12月17日
JXEV 回复于2018-12-17 16:48:23

5 463
请问大家用什么 FMC 的扩展板？
Xilinx FPGA 全志瑞芯微

机遇发布于2019年01月18日

0 383
问一下可不可以单独使用zynq的fpga这一块？
Xilinx FPGA 君正三星

LighBlade 发布于2018年12月30日
LighBlade 回复于2018-12-30 13:23:10

5 509
请问出现这种警告是什么原因？
Xilinx FPGA 高通三星

tigercat 发布于2019年01月29日

0 434
冰眼原理图已基本完成，放出来大家看一下，顺便简单介绍下各部分原理
新唐 Xilinx 三星

fjh 发布于2015年09月21日
qn1538987329 回复于2018-10-09 14:59:18

36 1.2w
海思hi3751 Android 存储开发指南
sss 君正 MTK Xilinx 三星

kenneth197 发布于2020年01月14日

0 422
像这样的信息是否表示驱动加载成功？
sss Xilinx 树莓派

zzl454646903 发布于2017年07月12日

0 904
gb28181 客户端代码
sss 君正 MTK 新唐 Xilinx

途行者阿杜发布于2020年02月24日
david 回复于2020-06-16 14:27:00

5 595
网盘上虚拟机的密码是123456
sss 高通 Xilinx

途行者阿杜发布于2017年07月30日
hero 回复于2018-01-29 08:29:59

2 1.2k
君正授权一版本SDK给我们论坛使用
君正新唐 Xilinx

途行者阿杜发布于2018年11月15日
helezh 回复于2019-06-23 15:45:58

5 1.4k
请问，i2c仲裁丢失是什么原因引起的？
Xilinx FPGA sss 三星

firstpic 发布于2018年12月12日
win992590594 回复于2020-07-03 14:07:34

1 334
请问怎么用ps 访问pl的印脚？
Xilinx FPGA 高通 MTK

qyp1647 发布于2019年01月13日
Jako 回复于2019-01-13 10:49:39

2 383
请问有人知道为什么我示波器存储深度到140M但我U盘读出来什么只有1k左右啊？
Xilinx FPGA 全志瑞芯微

beegeen 发布于2018年12月21日

0 272
请问一下大佬们，下面这个是怎么弄出来的
Xilinx FPGA 君正 MTK

tvmnu 发布于2019年01月23日

0 429
请问有人做过对CPLD外部晶振检测的逻辑吗？
Xilinx FPGA 瑞芯微高通

sunack 发布于2019年01月08日
sunack 回复于2019-01-08 15:36:13

1 405
Hi3518E的 SDK
sss 君正 MTK OpenCV Xilinx

pnhsd035 发布于2019年08月22日
iokuraki 回复于2020-06-12 00:48:34

20 1.8k
有没有哪位大侠贡献一份原理图出来HI3520D
sss Xilinx 树莓派

ISBENAN 发布于2016年11月08日

0 906
交叉编译qt出现错误，求帮助
sss 君正 Xilinx

qn1527562850 发布于2018年06月21日
qn1527562850 回复于2018-06-24 09:37:39

3 1.1k
大神们，请问zedboard板子可以用USB供电么？
Xilinx FPGA 瑞芯微高通

ww0705 发布于2018年12月07日

0 411
ALTREA 的cpld，型号是EPM240，用的编译环境是Quartus，编程方式是原理图方式。现...
Xilinx FPGA 君正全志

sailshadow 发布于2018年12月17日
efool 回复于2018-12-17 17:01:41

3 440
FPGA上实现网络通信用的什么协议？
Xilinx FPGA sss 屏显

salem83 发布于2019年01月18日
hai 回复于2019-01-18 15:54:06

7 458

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